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DAC 的內(nèi)部電路構成無太大差異,一般按輸出是電流仍是電壓、能否作乘法運算等進行分類。大多數(shù)DAC由電阻陣列和n個電流開關(或電壓開關)構成。按數(shù)字輸入 值切換開關,產(chǎn)生份額于輸入的電流(或電壓) 。此外,也有為了改善精度而把恒流源放入器件內(nèi)部的。DAC分為電壓型和電流型兩大類,電壓型DAC有權電阻網(wǎng)絡、T型電阻網(wǎng)絡和樹形開關網(wǎng)絡等;電流型 DAC有權電流型電阻網(wǎng)絡和倒T型電阻網(wǎng)絡等。

ADC的首要技術目標

1. ADC分辨率指輸出數(shù)字量改變一個最低有用位(LSB)所需的輸入模仿電壓的改變量。

2. ADC的精度決定于量化差錯及體系內(nèi)其他差錯之總和。一般精度目標為滿量程的±0. 02% ,高精度目標為滿量程的0. 001%。

3 .轉(zhuǎn)化速率是指完成一次從模仿轉(zhuǎn)化到數(shù)字的AD轉(zhuǎn)化所需的時刻的倒數(shù)。積分型AD的轉(zhuǎn)化時刻是毫秒級屬低速AD,逐次比較型AD是微秒級屬中速AD,全并行/串并行型AD可到達納秒級。

4. 量化差錯由于AD 的有限分辨率而引起的差錯,即有限分辨率AD的階梯狀搬運特性曲線與無限分辨率AD (抱負AD)的搬運特性曲線(直線)之間的最大偏差。通常是1個或半個最小數(shù)字量的模仿改變量,標明為1LSB、1 /2LSB。

DAC的首要技術目標

1 .分辨率指輸出模仿電壓的最小增量,即標明DAC輸入一個最低有用位(LSB)而在輸出端上模仿電壓的改變量。

2. 樹立時刻是將一個數(shù)字量轉(zhuǎn)化為穩(wěn)定模仿信號所需的時刻,也能夠認為是轉(zhuǎn)化時刻。DA中常用樹立時刻來描述其速度,而不是AD中常用的轉(zhuǎn)化速率。一般地,電流輸出DA樹立時刻較短,電壓輸出DA則較長。

3 .精度是指輸入端加有最大數(shù)值量時,DAC的實踐輸出值和理論計算值之差,它首要包括非線性差錯、份額體系差錯、失調(diào)差錯。

4 .線性度在抱負情況下,DAC的數(shù)字輸入量作等量添加時,其模仿輸出電壓也應作等量添加,可是實踐輸出往往有偏離。

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